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  1. ad9288

    1下载:
  2. 使用FPGA控制AD9288,方便移植,可以拿来直接使用,适合新手学习-Use FPGA control AD9288, easy migration, can be used to directly use for novices to learn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:41.88kb
    • 提供者:lishh
  1. I2C-bus

    0下载:
  2. 8051 based complete high speed I2C Program with stimulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:41.87kb
    • 提供者:Mick
  1. UART vhdl代码

    0下载:
  2. 基于FPGA的异步串口通信
  3. 所属分类:VHDL编程

    • 发布日期:2008-12-01
    • 文件大小:41.87kb
    • 提供者:hehe520
  1. finalcoursework

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  2. 用VHDL代码写的模拟微处理器核程序,有计算模块和register file 等模块,并包含测试程序,调试程序 ACTIVE HDL-Simulation with the VHDL code is written in the microprocessor core procedures, such as computing modules, and register file module, and includes test program, the debugger ACTIVE HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:41.83kb
    • 提供者:三木
  1. juanji2

    0下载:
  2. 用TI DSP汇编指令进行程序设计:“TIC54XDSP汇编程序设计-卷积-compiled using TI DSP Programming instructions : "TIC54XDSP compilation of program design-convolution
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:41.8kb
    • 提供者:李博宁
  1. Han-carlson.ppt

    0下载:
  2. Abstract—Variable latency adders have been recently proposed in literature. A variable latency adder employs speculation: the exact arithmetic function is replaced with an approximated one that is faster and gives the correct result most of the time,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:41.78kb
    • 提供者:preethi/charu
  1. Adnence_add8

    0下载:
  2. VHDL实现的超前进位加法器-the VHDL-ahead Adder
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:41.77kb
    • 提供者:安鹏洲
  1. spram

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  2. vhdl code of single port ram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:41.76kb
    • 提供者:vishal
  1. led

    0下载:
  2. 本程序演示了单片机对各个io的控制,控制led灯的亮和灭-This program demonstrates the control of the microcontroller for each io control led lights turn on and off
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:41.75kb
    • 提供者:suhong
  1. display

    0下载:
  2. seven segment display apllication with only one push button up counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:41.75kb
    • 提供者:resul koksal
  1. PSK

    0下载:
  2. 实现psk调制解调,vhdl代码,仿真文件也有-psk shixian tiaozhiyujietiao
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:41.72kb
    • 提供者:曹华杰
  1. up_counter_8

    0下载:
  2. Code for 8bit up counter in Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:41.72kb
    • 提供者:zsan
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