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  1. VHDL_1

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  2. 使用硬體描述語言HDL 設計硬體電路,台湾人写的PPT讲义,非常不错。VHDL硬件设计入门学习。VHDL基本語法架構,VHDL的零件庫(Library)及包裝(Package)等内容。
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-20
    • 文件大小:17.89kb
    • 提供者:WeimuMa
  1. Projec2

    0下载:
  2. Delay Generator using VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:17.88kb
    • 提供者:MohanadY
  1. Verilog11

    0下载:
  2. 这个是用可编程器件进行仿真CPU的程序,大家一起分享拉-this device is programmable CPU simulation procedures to share with everyone Rafah
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:17.88kb
    • 提供者:982134
  1. amba_verilog

    2下载:
  2. IC设计相关,arm内的AMBA桥实现的源码,verilog语言实现,
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:17.88kb
    • 提供者:伊路发
  1. labviewtoexcel

    0下载:
  2. labview实现向excel指定位置书写
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-16
    • 文件大小:17.87kb
    • 提供者:xpl
  1. alu_inverter

    0下载:
  2. 4bit ALU 利用vhdl语言编写的4位ALU 开发环境是在windows下-Band ALU using VHDL language prepared by the four ALU is a development environment under Windows
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:17.86kb
    • 提供者:bob
  1. sd_reader.rar

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  2. SD卡读卡器模块的VHDL及软件驱动代码,可作为外设挂接在Avalon总线上。支持以SD模式、4线模式读取。在24MHz时钟驱动下读取速率可达8MByte/s,SD card reader module and software drivers VHDL code, can be articulated as a peripheral bus in Avalon. To support the SD model, 4-wire mode read. Driven by the 24MHz clo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-21
    • 文件大小:17.85kb
    • 提供者:ctqy
  1. da

    0下载:
  2. 单片机显示程序,能够接受来自DDS的信息,在液晶显示屏上显示当前输出波形和频率-Single-chip display program that can receive information from the DDS, the LCD display shows the current output waveform and frequency
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:17.84kb
    • 提供者:张良哲
  1. halfadder

    0下载:
  2. this the vhdl code for half adder with rtl view and simulations-this is the vhdl code for half adder with rtl view and simulations
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:17.83kb
    • 提供者:roby
  1. e1_vhdl

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  2. 用VHDL在FPGA内部实现E1的接口,适合通讯相关专业硬件开发使用-Within the FPGA implementation using VHDL E1 interface, the hardware for communications-related professional development to use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:17.83kb
    • 提供者:彭涛
  1. 13july

    0下载:
  2. according to that pdf file speifications it was designed by me(HANEESH).
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:17.83kb
    • 提供者:haneesh
  1. verilog

    0下载:
  2. Different Verilog codes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:17.82kb
    • 提供者:arsal
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