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  1. uart

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  2. 实现串口发送和接收功能,数据处理模块可自行修改。(Serial port to send and receive functions, data processing module can modify its own.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-27
    • 文件大小:6kb
    • 提供者:Nate777
  1. AT25160B

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  2. 该代码完成存储器的数据存储和读取功能,该芯片是一款Atmel的SPI接口的EEPROM存储芯片。(The code completes the memory data storage and reading function, the chip is a Atmel SPI interface EEPROM memory chip.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:6kb
    • 提供者:leixiaoming
  1. chu_avalon_vga_de2

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  2. Embedded SoPC Design with Nios II Processor and VHDL Examples-VGA
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:6kb
    • 提供者:davido
  1. uart_ip

    0下载:
  2. 实现串口通信模块设置,包括频率分频、波特率产生、接口时序要求(Implementation of serial communication module settings, including frequency division, baud rate generation, interface timing requirements)
  3. 所属分类:VHDL/FPGA/Verilog

  1. keyboard

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  2. 一个用于FPGA开发板的键盘输入模块,可以在数码管中显示键盘对应编码,用于作为键盘输入。(A keyboard input module for FPGA development board.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-07
    • 文件大小:6kb
    • 提供者:xiiiiiii
  1. pio.7z

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  2. 配置pio,关于vxworks系统上,at91sam9g20(This routine performs such BSP-specific initialisation as is necessary before the architecture-independent cacheLibInit can be called. It is called)
  3. 所属分类:VHDL/FPGA/Verilog

  1. vhdl

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  2. 应用vhdl在实验箱上实现键盘扫描带有去抖并且移位(To realize the keyboard scan to shake and shift)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-10
    • 文件大小:6kb
    • 提供者:浪费
  1. SDRAM

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  2. 基于fpga与verilog语言的的sdram读写(SDRAM reading and writing based on FPGA and Verilog language)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-19
    • 文件大小:6kb
    • 提供者:司王星
  1. scia_loopback

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  2. C2000 F28069 USB to Mouse example(Ti C2000 F28069 USB to Mouse example)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-22
    • 文件大小:6kb
    • 提供者:JoeZhouq
  1. multi_cpu

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  2. 主要功能包含: // 1.按照CPU小系统规范要求,实现了各寄存器的读、写、控制等功能 // 2.实现了部分CPU读取配置字功能 // 3.实现了看门狗功能 // 4.实现了FLASH和BOOTROM控制功能 // 5.其它用户功能(按需进行添加)(The main functions include: According to the 1. / / CPU small system specifications, the realizatio
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:6kb
    • 提供者:fengyuanzyt
  1. PWN

    0下载:
  2. Pulse Width modulation using Verilog HDL
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-04
    • 文件大小:6kb
    • 提供者:liki20
  1. 4bit_mealy

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  2. Mealy machine is a state machine whose output is determined by the current state and the current inputs.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-03
    • 文件大小:6kb
    • 提供者:liki20
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