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  1. LP-LFSR

    0下载:
  2. LPLFSR for Low power test pattern generation_V
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:1.61kb
    • 提供者:hr
  1. SPI_veeren

    0下载:
  2. Serial peripheral interface using verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.69kb
    • 提供者:hr
  1. viterbi_decode_veeren

    0下载:
  2. Viterbi decoding algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.79kb
    • 提供者:hr
  1. Viterbi_algorithm_VeeRen

    0下载:
  2. Viterbi algorithm using Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:75.18kb
    • 提供者:hr
  1. SPI_verilog_veeRen

    0下载:
  2. serial peripheral interface using tx and rx
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1.17kb
    • 提供者:hr
  1. rtl_viterbi_veeRen

    0下载:
  2. RTL design Viterbi decoder using VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:5.58kb
    • 提供者:hr
  1. Tutorial.tar

    0下载:
  2. zedboard partial reconfiguration tutorial
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:553.29kb
    • 提供者:danny
  1. DS18B20_ok

    0下载:
  2. DS18B20转UART输出,每个温度点两个字节-DS18B20 to UART output,Two bytes each temperature
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:581.41kb
    • 提供者:胡文彬
  1. Pulse_tx

    0下载:
  2. 4路PPM 编码器,输入4位数字信号,输出ppm 脉冲序列,已测试过。-4bits ppm encoder.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.51kb
    • 提供者:胡钰
  1. VITA2000_Sensor_Board

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  2. 安富利关于视频开发的资料,使用FPGA设计。-Avnet information on video development, the use of FPGA design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:5.81mb
    • 提供者:黄广
  1. spi_bootloader_demo_file

    0下载:
  2. 安富利关于SPI Bootloader设计的全套资料,用于microblaze开发。-Avnet full set of data on SPI Bootloader designed for microblaze development.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.41mb
    • 提供者:黄广
  1. LED_vhdl

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  2. 8个LED灯从左亮到右,再从右亮到左,很好的VHDL入门程序,介绍了状态机的基本编写模式。-8 LED lights lit left to right, then right to left, bright, good VHDL entry procedures, introduces the basic writing mode state machine.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.59kb
    • 提供者:fan
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