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  1. steppercontrol

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  2. 一个步进电机控制器的程序,包含了两个电机的控制,一路编码器的接收,串口的接收,脉冲的输出,非常综合-Stepper motor controller program contains two motor control, all the way to the reception of the encoder, serial receiver, pulse output, very comprehensive
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:14.9mb
    • 提供者:bingo
  1. four-adder-design

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  2. 可编程逻辑设计-用VHDL语言进行四位加法器的设计-Programmable logic design _ four adder design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:1.18mb
    • 提供者:lunfei
  1. Deco7seg

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  2. uso de display en lenguaje VHDL
  3. 所属分类:VHDL-FPGA-Verilog

  1. shumaguan2

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  2. 七段数码管 VHDL 电子钟 简单的 加油-i don t know how to fanyi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:303.56kb
    • 提供者:冯小明
  1. anjian

    0下载:
  2. 1)实现最大输入两位十进制数字的四则运算(加减乘除) 2)能够实现多次连算(无优先级,从左到右计算结果) -1) maximum input two decimal digits four operations (addition, subtraction, multiplication and division), 2) be able to achieve many even count (no priority, from left to right results)
  3. 所属分类:Driver develop

    • 发布日期:2017-11-11
    • 文件大小:147.56kb
    • 提供者:李飞
  1. study

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  2. 在PicoBlaze上实现VGA显示、LED移位、交通灯状态变化等功能-VGA display, LED shift state of the traffic lights on in the PicoBlaze changes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:3.68mb
    • 提供者:feng
  1. labview

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  2. FSFSFSFSFSF GDGDGLABVIEW可以看看
  3. 所属分类:VHDL编程

    • 发布日期:2013-01-15
    • 文件大小:566.47kb
    • 提供者:hu474722972
  1. uart_tx_and_rx

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  2. A verilog code for UART transmitter and receiver system-A verilog code for UART transmitter and receiver system...
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:1002byte
    • 提供者:EBIN JOY
  1. DE2_NIOS_HOST_MOUSE_VGA

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  2. 该设计使用了Nios II系统来演示如何在DE2开发板上的USB主机端口连接到一个USB设备进行通信。本设计实现了一个单色显示屏,预加载的图像,用户可以利用它与鼠标。应连接到VGA端口,一个USB鼠标连接到USB主机端口和一个CRT/ LCD显示器。-This designs uses a Nios II system to demonstrate how to communicate with a USB device connected to the USB HOST port on the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:5.79mb
    • 提供者:黯魂天残
  1. uart_verilog

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  2. 串口标准通讯,带奇偶校验和通讯超时故障,带测试文件-The serial standard communication with test files
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:9.19kb
    • 提供者:郭延冲
  1. PID-CPLD

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  2. 文章描述是关于智能PID的CPLD实现形式,内容详实,极具参考价值-The article describes the CPLD on Intelligent PID forms of informative, has great reference value
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:67.05kb
    • 提供者:chenfei
  1. DE2_Default

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  2. DE2的默认例程:当电路板供电的,这样的设计是最初的设计。递增计数器显示值 7段显示器和发光二极管。也显示图像的VGA端口上。-This design is the initial design when the board is powered-up. It increments a counter and displays the value on the 7-segment displays and LEDs. An image is also displayed on the V
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:3.06mb
    • 提供者:黯魂天残
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