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  1. _12_DA[TLC5615]_1

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  2. 通过DA输出正弦波,频率1KHz ad采用的是TLC5615 输出的正弦波与理想波形基本一样-DA output sine wave frequency 1KHz The ad is TLC5615 The sine wave output with the ideal waveform is basically the same
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-03
    • 文件大小:2.85mb
    • 提供者:江风
  1. CPLD_AD_AVR

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  2. CPLD程序,程序中实现了PWM波的产生、ADS8364并行高速AD的读写控制,与AVR单片机的通信控制。CPLD以类似外部RAM的方式被AVR读写,AVR单片机只需要向固定的地址写入或者读取即可。 本程序对高速数据采集系统有很好的参考作用,可以以此修改为其他应用场合。-The CPLD program, the program to achieve a PWM wave generation high-speed AD ADS8364 parallel read and write con
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:4.25kb
    • 提供者:emouse
  1. fenfshan

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  2. 风扇的verilog控制程序,有强风,弱风,睡眠等各种功能-Verilog control procedures of the fan, strong wind, low wind, sleep and other functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-20
    • 文件大小:249.08kb
    • 提供者:luo
  1. startup

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  2. Spartan-3E starter开发板入门例程的重新编译版本,本版本使用最新版ISE14.1重新编译。补充缺少的文件,实际测试通过。-Spartan-3E starter development board entry routine re-compiled version, this version use the latest version ISE14.1 recompile. Added missing files, through the actual test.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:907.36kb
    • 提供者:emouse
  1. jijiaqi

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  2. 出租车的计价器,描述了实际出租车的工作状态-Taxi meter, described the state of the actual taxi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:3.76kb
    • 提供者:luo
  1. FPGA_PWM_ADS8364_STM32

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  2. FPGA实现的PWM产生,ADS8364并行AD控制、STM32控制读写操作源码。包含完整工程文件。-FPGA Implementation of PWM, ADS8364 the parallel AD control, STM32 control the read and write operations source. Contains the complete project file.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:208.54kb
    • 提供者:emouse
  1. fenpin3

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  2. 对波形进行50 占空比的3分频,仿真通过-50 duty cycle of the waveform divided by simulation through
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:154.88kb
    • 提供者:luo
  1. uartfifo

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  2. 同步异步传输协议的应用通过调试助手向FPGA发送数据,然后再读出来,-Application of synchronous and asynchronous transmission protocol to send data to the FPGA debugging assistant, and then read out
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:792.35kb
    • 提供者:路江海
  1. SPI_Master_module

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  2. 利用VHDL语言编写的SPI主机模块,采用内部自环回已经经过测试,发送接收数据正常,里面有modelsim工程,可以验证下仿真波形-SPI host module using VHDL language, has passed internal self-loopback test, sending and receiving data normally modelsim project, which can be verified under simulation waveforms
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:950.8kb
    • 提供者:小辉
  1. imageprocess

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  2. 典型的图像采集verilog代码,开发板源码-this is typical image process code,provided by xilinx developmentpacadge
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:25.15kb
    • 提供者:chenzhi
  1. pmd

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  2. 一个跑马灯程序,加入了变速,变换方向,设定初始图形,以及分离为两个跑马灯的功能-A marquee program, adding a variable speed, change direction, set the initial graphics, and separated into two marquees functionality
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:6.94kb
    • 提供者:陈偕行
  1. verilog_pwm_led

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  2. 基于fpga的pwm灰度控制led代码,简洁易懂-FPGA-based control led pwm gray code, simple and easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:557byte
    • 提供者:李李
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