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  1. 02_run_flash_led

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  2. 利用黑金开发板AX301开发的第一个实验,流水灯,适用于初学者,调试通过-Black Gold AX301 use development board developed the first experiment, water lights, suitable for beginners, debugging through
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.07mb
    • 提供者:朱孟元
  1. fixed_pointDivider

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  2. 关于定点除法的VHD实现,找了好久,奉献出来大家一起学习!-fixed_point divider is implemented in FPGA .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:388.13kb
    • 提供者:刘苍
  1. piso_beha_tb

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  2. parllel toserial out test bench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:609byte
    • 提供者:pranav ette
  1. priorityencodtest

    0下载:
  2. parity encoder test bench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:605byte
    • 提供者:pranav ette
  1. mod_n_counter_tb

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  2. MODULO N COUNTER VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:570byte
    • 提供者:pranav ette
  1. johnson_count_tb

    0下载:
  2. JHONSON COUNTER TEST BENCH
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:588byte
    • 提供者:pranav ette
  1. d_ff_cout_tb

    0下载:
  2. D FLIP FLOP TEST BENCH
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:590byte
    • 提供者:pranav ette
  1. qpsk_mod

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  2. QPSK modulation using vhdl programming ..i hope it ll be useful-QPSK modulation using vhdl programming ..i hope it ll be useful...
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:8.61kb
    • 提供者:she-sheetal
  1. VHDL

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  2. VHDL,介绍简单的语句,有计时器、频率计等例子。-Very-High-Speed Integrated Circuit Hardware Descr iption Language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.25mb
    • 提供者:Chensheng Mao
  1. draw_char_type

    0下载:
  2. FPGA字符显示控制,RAM作为显存地址存放现在内容,ROM作为显示字模。-FPGA character display control, RAM memory address is stored as the content now, ROM as a display font.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.19mb
    • 提供者:xiaomei
  1. video_form_convert

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  2. 将ADV7181解码出来的数字视频,提取亮度信号作为视频输出。-The ADV7181 decoded digital video, the luminance signal is extracted as a video output.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:7.78mb
    • 提供者:xiaomei
  1. video_shape_center

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  2. FPGA将二值化的视频提取目标的位置信息,最终计算出目标的型心。-FPGA binarized video extract location information of the target, the final calculation of the target core.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.61mb
    • 提供者:xiaomei
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