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  1. vmm_exam

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  2. vmm 验证方法学的学习实例(源代码),分步骤剖析整个验证设计过程-vmm verification methodology of learning examples (source code), the design process step by step analysis of the entire verification
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:55.49kb
    • 提供者:林不野
  1. led

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  2. 基于fpga的流水灯仿真以及代码。 包含了整个过程。本人刚刚做过程序在quarter2下仿真成功! -The water-based light simulation and fpga code. Includes the whole process. I just did the program under emulation in quarter2 success!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:172.37kb
    • 提供者:蒋翔
  1. FIRde-verilog-shixian

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  2. 有符号DA算法的FIR滤波器的Verilog实现-A symbol of the algorithm of DA FIR filters Verilog realized
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:3.94kb
    • 提供者:紫微
  1. freq_div

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  2. 用verilog实现基于fpga的通用分频器,-Divider using verilog achieve common
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:67.35kb
    • 提供者:mend
  1. eros

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  2. 俄罗斯方块程序。-FPGA development board schematics
  3. 所属分类:VHDL编程

    • 发布日期:2019-02-02
    • 文件大小:4.12mb
    • 提供者:韩凯
  1. fifo_vhdl

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  2. 基于vhdl语言实现的fifo控制器。经过仿真及实际测试-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:608.23kb
    • 提供者:刘新宇
  1. shizihong

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  2. 用VHDL语言编写数字钟的程序,实现数字钟的几个功能,如计时、校时、闹钟和整点报时-Digital clock using VHDL language programs, digital clock several functions, such as timing, timing, alarm and hourly chime
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:2kb
    • 提供者:小西
  1. EDACLOCK

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  2. 用VHDL语言编写数字钟的程序,实现数字钟的完整功能,如计时、校时、闹钟和整点报时-Digital clock using VHDL language programs, digital clock several functions, such as timing, timing, alarm and hourly chime
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:385.71kb
    • 提供者:小西
  1. EP2C8_PER_VGA

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  2. VGA的驱动程序,DE2的例程,适用于初学者了解VGA的操作!-VGA driver, DE2 routine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:691.48kb
    • 提供者:苗成林
  1. PC_WR_EEPROM

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  2. 利用altera公司的FPGA使用verilog语言实现对EEPROM的读和写的功能 利用串口发送数据-Altera FPGA verilog language to achieve the serial port to send data to the EEPROM read and write
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-24
    • 文件大小:2.24mb
    • 提供者:李枫
  1. FPGA_DDR-SDRAM

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  2. FPGA对SDRAM的控制,有部分源码,-FPGA SDRAM control, part of the source,...
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5.15mb
    • 提供者:白建永
  1. DES.zip

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  2. DES 加密算法的实现,使用硬件描述语言VHDL编写,DES encryption algorithm realization, uses hardware descr iption language VHDL to compile
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:23.59kb
    • 提供者:zfhustb
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