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  1. PIC_EEPROM

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  2. 改程序实现了PIC单片机读取外部EEPROM主要是通过串行SCI方式进行读取。-Program for the PIC microcontroller to change the external EEPROM read mainly by way of reading the serial SCI.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:11.81kb
    • 提供者:吴传平
  1. i2c

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  2. I2C接口程序,整个工程文件,文人已仿真,下载,在FPGA上测试成功 verilo语言-I2C interface programme,the whole project file,I have simulated and tested in FPGA successfully .verilog language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:713.1kb
    • 提供者:王建伟
  1. LCD12864_TEST

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  2. VHDL语言,12864显示屏的驱动程序,本人已在自己开发板上测试成功,需要的朋友下载后根据自己的开发板稍加修改即可-VHDL, 12864 display driver, I have tested successfully in my own test board, you need slightly modified according to your own test board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:445.64kb
    • 提供者:王建伟
  1. LCD1602

    0下载:
  2. VHDL语言,1602显示屏的驱动程序,本人已在自己开发板上测试成功,需要的朋友下载后根据自己的开发板稍加修改即可 - 1602 display driver, I have tested successfully in my own test board, you need slightly modified according to your own test board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:451.86kb
    • 提供者:王建伟
  1. xiayuwen

    0下载:
  2. 本程序是夏宇闻老师的verilog数字系统设计教程中的E2PROM完整程序文件,包括信号产生模块,E2PROM读写模块,E2PROM模拟模块,并且在ISE上运行成功,测试正确,modelsim仿真成功-This program is the Xia Yu Wen digital system design tutorial E2PROM complete file, including the signal generation module, E2PROM reader module, E2P
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:48.83kb
    • 提供者:王建伟
  1. Telephone-billing-programme

    0下载:
  2. 电话计费功能程序,VHDL语言编写,已测,无任何问题-Telephone billing function program, VHDL language, has been measured, without any problems
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:15.8kb
    • 提供者:王建伟
  1. 16-bit-high-speed-digital-correlator

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  2. 16 位高速数字相关器功能模块,VHDL语言编写-16-bit high-speed digital correlator modules, VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:3.41kb
    • 提供者:王建伟
  1. FPGA---Serial

    0下载:
  2. FPGA实现的串口程序,包含顶层调用的代码。-FPGA implementation of the serial program, including top-level calling code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:3.55kb
    • 提供者:周华飞
  1. ROM

    0下载:
  2. 用组合电路实现的ROM功能模块,用VHDL语言编写-The ROM circuit with a combination of functional modules, VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:174.09kb
    • 提供者:王建伟
  1. frame

    0下载:
  2. 长帧同步时钟的产生功能模块,VHDL语言编写-Long frame sync clock generation function modules, VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:182.81kb
    • 提供者:王建伟
  1. reg

    0下载:
  2. Synchronous register (Behavioral representation) - an 8-bit register to store the values of switches SW7-SW0 on the outputs LEDR7-LEDR0 as the key KEY0 is pressed.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:236.77kb
    • 提供者:dawnofangry
  1. shiftreg

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  2. Shift regisiter altera de1 board example
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:597byte
    • 提供者:Jhon
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