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  1. ram_4_4

    0下载:
  2. this is a 2 bit ram for xilinx whit ise 9.2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:676.32kb
    • 提供者:mkr
  1. SOC-pracs----43

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  2. VHDL CODE FOR system on Chip pracs pune University ME 2013 PATTERN
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:676.55kb
    • 提供者:javad
  1. The-8-down-counter-design

    0下载:
  2. 带异步复位和计数使能控制的8位二进制减法计数器设计-With asynchronous reset and the count enable control 8 bit binary subtraction counter design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:676.56kb
    • 提供者:于永远
  1. vending-machine-project

    0下载:
  2. vending machine VHDL FPGA Altera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:676.87kb
    • 提供者:Ipan
  1. IIC

    0下载:
  2. 利用程序实现IIC总线读写数码管显示,并通过开发板验证-Program for IIC bus read and write using digital display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:676.91kb
    • 提供者:何勇
  1. DDRSDRAM_controller

    0下载:
  2. ddr sdram控制器,lattice器件的参考设计,比较详细-ddr sdram controller, lattice components of the reference design, very detailed
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:676.97kb
    • 提供者:魏序
  1. VHDLcommen-erro-in-all

    0下载:
  2. VHDL编程常见错误搜集。这些错误大多是初学者常见的错误。-VHDL Programming Common Errors collection. Most of these errors is a common mistake for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:677kb
    • 提供者:段雄
  1. vga

    0下载:
  2. vga 使用vhdl语言实现一张图片的显示,具有完整的工程及源代码,下载验证通过(注意硬件差别)-vga vhdl language to display a picture, have a complete engineering and source code, download the verification (note the hardware differences)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-13
    • 文件大小:677kb
    • 提供者:liezhuo
  1. DE2-115_Basic_Computer

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  2. BASIC COMPUTER FOR JTAG_UART
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-24
    • 文件大小:677kb
    • 提供者:chun354
  1. rili

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  2. 北邮的大作业,基于ISE试验箱编程的万年历,LCD数码管显示,可以开关控制,测试成功-Great job BUPT, based on the ISE chamber programming calendar, LCD digital display, you can switch control, the test is successful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:677.14kb
    • 提供者:李倩
  1. wf

    0下载:
  2. 30实验三十:利用程序实现IIC总线读写数码管显示-The 30experiment thirty : the use of procedures for the realization of IIC bus read and write digital tube display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:677.16kb
    • 提供者:钟安
  1. spi_controller

    0下载:
  2. spi master controller示例设计,总体构架设计,测试程序-Spi master controller design example, total structure design, test procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:677.31kb
    • 提供者:wu
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