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  1. modulsim_use_ise_derectly

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  2. 一个简单的使用modlsim直接调用ise的实例,自己当时写的,通过编写do文件直接用modlsim来调用ise的核文件仿真。仅供学习参考-use modulsim call the ise file derectly by writing do file in the modulsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.3mb
    • 提供者:havi
  1. e002_synopsys

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  2. sysnopsys的cocentric软件及system C使用说明-cocentric the sysnopsys software and use system C
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.3mb
    • 提供者:沈杰
  1. DE2shijian(2)

    0下载:
  2. FPGA与SOPC设计教程:DE2实践-第二章 fpga设计介绍-FPGA and SOPC design tutorials: DE2 Practice- Introduction Chapter II fpga design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.3mb
    • 提供者:lu
  1. MOTO3--zhiliu

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  2. 运行于Altera Cyclone FPGA平台,顶层为原理图方式,模块由VHDL编写的直流电机驱动程序。-Running on Altera Cyclone FPGA platform, the top of the schematic way, the module VHDL prepared by the DC motor driver.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.3mb
    • 提供者:qiao
  1. 夏宇闻-Verilog经典教程

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  2. 夏宇闻-Verilog经典教程
  3. 所属分类:VHDL编程

    • 发布日期:2011-07-05
    • 文件大小:1.3mb
    • 提供者:wanwendian
  1. CBPFPGA

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  2. 很好的FPGA学习资料,不要错过,xilinx学习经典-it is good to study the FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:1.3mb
    • 提供者:liuhai
  1. verlog2

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  2. VHDL语言的资料.课本讲解.对于各种编码规则都有介诏
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.3mb
    • 提供者:文敏
  1. texi

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  2. 出租车计费器。verilog语言设计,合理利用了de2开发板资源,功能全面-Taxi meter. verilog language design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:1.3mb
    • 提供者:zzh
  1. FPGA-verilog

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  2. 网上很有名的CB fpga大神的杰作,很是值得参考,适合入门者-Online very famous CB fpga great god s masterpiece
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.3mb
    • 提供者:caohongze
  1. LatticeECPEC

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  2. LatticeECP/EC系列培训教程,介绍器件,及使用方法-LatticeECP/EC series of training tutorials to introduce the device, and method of use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.3mb
    • 提供者:xch
  1. ass1_3_safe

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  2. The objective of this project is to design and implement the controller for an electronic safe. You will interface a 16-button keypad to the NIOS boards. The combination code of the safe will be the last “X” digits ) of 8 digits.-The objective of thi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.3mb
    • 提供者:wei chenghao
  1. DS18B20_test_3_vhdl

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  2. ds18b20温度传感器,使用vhdl实现-ds18b20 temperature sensor, achieved using vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.3mb
    • 提供者:qifo
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