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  1. linear

    0下载:
  2. 线性分组码编码电路和译码电路实现程序,仿真测试文件-Controls, coding, simulation test file linear block code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.36kb
    • 提供者:任一涵
  1. 8_8_FIFO_VHDL

    0下载:
  2. 这是关于VHDL的8*8FIFO源代码,欢迎大家下载使用
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.36kb
    • 提供者:张三
  1. LCDdriver

    0下载:
  2. It is the LCD driver where it can be used on any brand of LCD(mostly)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.36kb
    • 提供者:jason
  1. active-hdl-vhdl-code

    0下载:
  2. this vhdl source code for multiplexer,half adder,full adder,counter etc. for using in ACTIVE HDL and other vlsi softwares.-this is vhdl source code for multiplexer,half adder,full adder,counter etc. for using in ACTIVE HDL and other vlsi softwares.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:1.36kb
    • 提供者:anmol
  1. rmfilter

    0下载:
  2. 用VHDL语言实现由滤波器构成的最佳接收机-VHDL language with the best achieved by the receiver filter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.36kb
    • 提供者:筱雲
  1. SPI_slave

    0下载:
  2. spi的从机模式,实现数据的双向传输,本人用来传输aes数据-spi slave mode
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.36kb
    • 提供者:骆钦榕
  1. lcd_hs162

    0下载:
  2. HS162-4字符液晶显示控制源程序,使用Verilog硬件描述语言进行编程-HS162-4 character liquid crystal display control source, the use of Verilog hardware descr iption language programming
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.36kb
    • 提供者:zhaoyf
  1. Pc.v

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  2. 计算机中每一条机器指令的执行,都离不开程序计数器的正确执行,本程序实现程序计数器。-Computer implementation of each machine instruction, are inseparable from the correct implementation of the program counter, this program achieve the program counter.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:1.36kb
    • 提供者:江浩
  1. Lab10Part3

    0下载:
  2. Quarturs 环境Verilog文档。用于显示英文字符在7位标准LED显示板。不可以直接使用哦,记得更改对应的module名字。-Quarturs environment Verilog documents. English characters display panel for displaying the seven standard LED. Oh, can not be used directly, remember to change the name of the corres
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.36kb
    • 提供者:王强
  1. keypad

    0下载:
  2. a keypad scanner for 4*5 keypad
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.36kb
    • 提供者:pan yuming
  1. clk_div

    0下载:
  2. VERILOG实现多时钟,可以应用于流水线.输入CLK,输出CLK1,CLK2,CLK3
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.36kb
    • 提供者:kaimen
  1. 555

    0下载:
  2. 键盘扫描verilog代码
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.36kb
    • 提供者:edison
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