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  1. ADCS5451A_Sample

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  2. 用verilog语言实现的ADCS5451 AD转换芯片的控制与数据读取。-Using verilog language to achieve ADCS5451 AD converter chip control and data read.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.42kb
    • 提供者:贺风
  1. traffic

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  2. 学习VHDL语言入门程序——交通灯。对理解时序关系和VHDL基本语法很有帮助。-Learning VHDL language entry procedures- traffic lights. Understanding of the relationship between the timing and VHDL basic grammar.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.42kb
    • 提供者:唐宏伟
  1. CORDIC_SVD

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  2. 2X2 matrix s SVD used Cordic
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.42kb
    • 提供者:zhangpeng
  1. spi

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  2. vhdl spi pin configuration
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.42kb
    • 提供者:mohamad
  1. randomizervhdl

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  2. Randomizer Vhdl he RTL now is working correctly, and the TB also is working but there is a problem in the sequence of the reset and and the load
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:1.42kb
    • 提供者:amrnour
  1. ChessClock

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  2. Example of Chess Clock implementation in ABEL decription language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.42kb
    • 提供者:John
  1. Verilogtrafficcontrol

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  2. 这是一个用Verilog编写的一个交通灯控制程序
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.42kb
    • 提供者:王横
  1. vgaDriver

    0下载:
  2. This Verilog document contains the driver to interface an FPGA to a monitor, using the VGA input.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:1.42kb
    • 提供者:danisan
  1. parallel8_serial

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  2. V5 FPGA中8:1并串转换输出,可供初学者参考设计,涉及 OSERDES 原语的使用-the use of "OSERDES"
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.42kb
    • 提供者:lkg
  1. da_fir

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  2. DA实现FIR滤波器,8阶对称系数。滤波器输入位宽为12bit。-DA FIR filter implementation, 8 symmetric coefficients. Filter input bit width is 12bit.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1.42kb
    • 提供者:张雯
  1. LEDJZ

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  2. 宏晶单片机最新型号STC12C5A60S2矩阵键盘程序,已经过验证运行正常。-Macro crystalline matrix keyboard microcontroller program STC12C5A60S2 latest model has been verified to run correctly.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.42kb
    • 提供者:lhf
  1. spi_master_module

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  2. Simple VHDL SPI-module core source code (only spi-master)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.42kb
    • 提供者:Alex
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