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  1. a2

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  2. verilog实验:占空比1:2:1的周期波形-verilog experiment: waveform duty cycle 1:2:1
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:28.61kb
    • 提供者:zyx
  1. cordic_beh

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  2. 这是实现cordic算法的一些源程序,各文件的说明可以参见文件内部注释。 -This is the algorithm Coordinate rotation digital source, the documents of the internal documents can be found in the Notes.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:28.61kb
    • 提供者:喻小星
  1. SHUZIZHONGVHDL

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  2. 多功能数字钟的VHDL编程实现,有与其他数字钟不同的秒表,闹钟等更多功能-Multi-function digital clock of VHDL programming, digital clock with other different stopwatch, alarm clock function, such as more
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:28.6kb
    • 提供者:赵彪
  1. ofdm_vhdl

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  2. OFDM的VHDL代码,ofdm_vhdl文件,包括fft,ifft等模块,能正确运行得到结果-The VHDL code for OFDM, ofdm_vhdl documents, including fft, ifft other modules, can get the results correctly
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:28.6kb
    • 提供者:陈敏
  1. DE2_Top

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  2. DE2 驱动配置,LCD,LED,,Audio,VGA显示等功能-DE2 driver config to realise LCD/LED/VGA/Audio display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:28.59kb
    • 提供者:jerry
  1. work6ADCINT

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  2. ADC0809采样控制电路的实现ADC0809是CMOS的8位A/D转换器,片内有8路模拟开关,可控制8个模拟量中的一个进入转换器中,转换时间约100us。主要控制信号有,START是转换启动信号,高电平有效。ALE是3位通道选择地址(ADDC、ADDB、ADDA)信号的所存信号。当模拟量送至某一输入端(如IN1或IN2),由3位地址信号选择,而地址信号由ALE锁存。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:28.58kb
    • 提供者:lkiwood
  1. fpga_led

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  2. 这个源代码是由专业人士编的,其作用是点亮数码管,检验开发板的好坏!-This source code is made by professionals, and its role is to light up digital tube, test development board is good or bad!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:28.57kb
    • 提供者:祝宁
  1. FFT-of-VHDL-source-code

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  2. FFT的VHDL源代码,代码是实现快速傅里叶变换。-FFT in VHDL source code,The code is to realize fast Fourier transformation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:28.57kb
    • 提供者:周鑫
  1. fpga_led

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  2. 一个简单的VHDL例子,教新手怎么用VHDl-A simple VHDL example, to teach the novice how to use VHDl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:28.56kb
    • 提供者:沈旭科
  1. FFT_VHDL

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  2. fft是基本的信号处理算法,本程序为fft算法的VHDL语言-fft is a fundamental signal processing algorithms, the procedures for the fft algorithm VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:28.56kb
    • 提供者:老李飞刀
  1. FFT_VHDL

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  2. FFT的VHDL源文件,经过在Quartus II上的测试无错误
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:28.56kb
    • 提供者:沈克镇
  1. DDS

    0下载:
  2. 基于verilog的DDS设计验证与仿真源代码,在quartus上实现,下载仿真成功-Based on the the the verilog DDS design verification and simulation of the source code, in quartus download simulation success
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:28.5kb
    • 提供者:baixin358
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