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  1. rs_enc

    0下载:
  2. Verilog code for RS-(255,239) encoder.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:3.43kb
    • 提供者:sharat
  1. IFFT8pts

    0下载:
  2. VHDL code for IFFT8pts
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.43kb
    • 提供者:Nguyen Manh Dat
  1. cam_generic_8s

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  2. verilog 开发实例 无线通 信网络-verilog examples of the development of wireless communication networks
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:3.43kb
    • 提供者:鹧鸪天
  1. des_crypt_vhdl.tar

    0下载:
  2. Simple implementation of classic DES unix crypt()
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.43kb
    • 提供者:thefre
  1. shouhuoji

    0下载:
  2. 某自动售货机售A,B,C3种商品,他们的价格分别为1,3,4。 售票机进接受一元硬币。售货机面板上设有投币孔和退钱建,每种商品标识处有选择按键,上有指示灯表明当前投币说是否已经足够选买该商品。 -Vending machine sales to a certain A, B, C3 commodities, their prices were 1,3,4. Into the ticket vending machines to accept dollar coins. Coin dis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3.42kb
    • 提供者:王玉
  1. mc8051_siu

    0下载:
  2. mc8051中 源码串口单元输入输出vhdl语言设计-mc8051 vhdl code, Descr iption: Serial interface unit for the mc8051 microcontroller.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3.42kb
    • 提供者:Laura Ku
  1. main

    0下载:
  2. demux impelementation for vhdl muxing protocol
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.42kb
    • 提供者:lst__0
  1. EXAMPLES-ON-SYSTEM-VERILOG.tar

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  2. THIS FILE CONTAINS AROUND 20 USEFUL EXAMPLES ON SYSTEM VERILOG (MEMORY-ARRAYS,LOGICS,DATATYPES ETC.)-THIS FILE CONTAINS AROUND 20 USEFUL EXAMPLES ON SYSTEM VERILOG (MEMORY-ARRAYS,LOGICS,DATATYPES ETC.)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.42kb
    • 提供者:ladu
  1. fq_div

    0下载:
  2. 一种实现任意整数分频的VHDL源代码,已经经过调试-Achieve an arbitrary integer divider of the VHDL source code, has been testing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.42kb
    • 提供者:王双
  1. timer_led

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  2. nios2 IDE ,时钟程序,实现其主要功能如下:1.在液晶屏上显示时间、日期、状态提示;2.在控制台上显示时间、日期、状态提示;3.对时间、日期能够进行设置;4.在8位七段显示器上显示时间、日期;5. 整点报时功能(利用LED闪烁提醒)。请根据请添加的cpu系统更改其中的调用名称。-nios2 IDE, clock procedures to achieve its main function is as follows: 1. Displayed on the LCD screen tim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:3.42kb
    • 提供者:cd
  1. traffic_light

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  2. 基于VHDL的交通灯,状态机实现,FPGA参考小程序-VHDL-based traffic lights, the state machine to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.42kb
    • 提供者:mend
  1. binarytobcd

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  2. it is code for binary to bcd
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:3.42kb
    • 提供者:naveen
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