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  1. delay

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  2. PWM整流器的死区延迟的VHDL编程,可以参考一下-VHDL programming PWM Rectifier dead-band delays
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:997byte
    • 提供者:
  1. VHDL

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  2. VHDL的参考手册,具有一定的参考价值,大家可以参考学习下-VHDL reference manual, with some reference value, you can refer to learn under
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.05mb
    • 提供者:
  1. debounce

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  2. 按键消抖是fpga学习 乃至编程语言学习的重要之重 我自己用的一个消抖程序真的很棒 希望对你有用 -Key jitter is an important FPGA learning and even programming language learning important to my own use of a shake out process is really great to be useful to you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:5.95mb
    • 提供者:Gent Liu
  1. about-the-experiment-of-FPGA

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  2. FPGA相关实验程序包括点阵、A/D、D/A转换-Related experimental procedures include dot matrix FPGA, A/D, D/A converter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5.14mb
    • 提供者:高应波
  1. 09_vga

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  2. FPGA源码资料 采用的是EP4CE15F17C8N这个硬件平台 VGA的源码-FPGA source code is the use of EP4CE15F17C8N hardware platform VGA source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-11
    • 文件大小:17.12mb
    • 提供者:
  1. 03_key_detect_1

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  2. FPGA源码资料 采用的是EP4CE15F17C8N这个硬件平台 按键检测的源码-FPGA source code is the use of EP4CE15F17C8N hardware platform for the detection of the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.07mb
    • 提供者:
  1. 02_run_flash_led

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  2. FPGA源码资料 采用的是EP4CE15F17C8N这个硬件平台 跑马灯的源码-FPGA data EP4CE15F17C8N is used in the hardware platform of marquee source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.1mb
    • 提供者:
  1. 01_run_led

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  2. FPGA源码资料 采用的是EP4CE15F17C8N这个硬件平台 流水灯的源码-FPGA source code is the use of EP4CE15F17C8N hardware platform for water lamp source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.1mb
    • 提供者:
  1. sin

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  2. 用VHDL语言编写实现以下功能:用PLL,复位器,分频器,同步时钟,计数器来产生正弦波,再在其上加扰,用FIR滤波器进行滤波整形,最后得到输出。-Using VHDL language to achieve the following functions: PLL, reset, clock synchronization, frequency divider, counter to generate sine wave, and then scrambling on the filter sh
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-23
    • 文件大小:6.47mb
    • 提供者:猪头
  1. Filtro

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  2. Digital filter in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:623byte
    • 提供者:jossss
  1. code

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  2. 实现RGB TTL信号的输出~可以推动任意分辨率的TFT-Achieve RGB TTL signal output- can push any resolution TFT
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:54.09kb
    • 提供者:黄同意
  1. Plong-master

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  2. Pong game use VGA controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:16.89kb
    • 提供者:Sergiu
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