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  1. led_fluid(DB)

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  2. 实现可控制的流水灯,适用于Cyclone IV E EP4CE115F29C7芯片,可以使用按键控制启停,控制流动方向等。-Control light water and apply to the Cyclone IV E EP4CE115F29C7 chip, you can use the buttons to control the start and stop, control the flow direction.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:2.99mb
    • 提供者:仲斐
  1. trafficlight

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  2. 交通灯程序,包括自动循环功能,人工转换功能等-Traffic lights program, including automatic cycle function, manual conversion function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:451.52kb
    • 提供者:dcc
  1. TLK1501

    0下载:
  2. tlk1501高速串行器/解串器,广泛应用于通讯系统,视频监控系统,户外LED 显示系统等。-tlk1501 high-speed serializer/deserializer, widely used in communication systems, video surveillance systems, outdoor LED display system.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:284.47kb
    • 提供者:tyz
  1. sdram

    0下载:
  2. sdram控制器的Verilog描述 测试可用-the sdram controller Verilog descr iption of test available
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:8.15kb
    • 提供者:刘备
  1. cordic23

    0下载:
  2. CORDIC算法的文件 还有测试文件 经测试可用-The CORDIC algorithm file also test files used by the test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:3.24kb
    • 提供者:刘备
  1. AD0809

    0下载:
  2. AD0809的FPGA控制,适合初学者当做例程-AD0809 FPGA control, suitable for beginners as routine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:4.19mb
    • 提供者:金浩强
  1. FIFO

    0下载:
  2. FIFO的资料,包括文档说明已经一个VHDL文件。-FIFO data, including document describes a VHDL file.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:1.13mb
    • 提供者:金浩强
  1. chuan_to_bin

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  2. 串转并,信号串转成并的VHDL实现,很有用。-String transfer and signal string and convert VHDL to achieve useful.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:650byte
    • 提供者:金浩强
  1. shft_reg

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  2. 移位寄存器的VHDL语言实现,quartus 和 modelsim 仿真-Shift register VHDL language quartus and modelsim simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:4.17mb
    • 提供者:金浩强
  1. clock

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  2. 数字计时器的vhdl实现,quartus 和 modelsim 仿真-Digital timer vhdl achieve quartus and modelsim simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-17
    • 文件大小:4.32mb
    • 提供者:金浩强
  1. configuration_selectmap20110310

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  2. 实现两个FPGA与PROM之间的通信,PROM先与第一个FPGA通信,然后通过第一个FPGA与第二个FPGA通信-Communication between the two FPGA and PROM, PROM first and FPGA communication, and then through the the first FPGA second FPGA communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:214.09kb
    • 提供者:Shane
  1. Extended_Euclid

    0下载:
  2. Extended Euclidean using Spartan3 FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:100.27kb
    • 提供者:Asif
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