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  1. Multiplexer-Description2

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  2. 通过应用QUARTUSII开发软件对 四选一多路选择器进行设计,并给出运行结果-Software development through the application of QUARTUSII choose one of four multiplexer design, and operating results are given
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:14.25kb
    • 提供者:renee
  1. 3-8-encoder-design

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  2.  通过应用QUARTUSII开发软件对3—8译码器进行设计,给出运行程序和结果-Development through the application of QUARTUSII 3-8 decoder software for design, operational procedures and results are given
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:18.94kb
    • 提供者:renee
  1. Describe-counter

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  2.  通过应用QUARTUSII开发软件对用if语句描述二进制(M=10)计数器进行设计,并给出运行结果-Software development through the application of QUARTUSII if statement with the descr iption of the binary (M = 10) counter design and operation results are given
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:14.26kb
    • 提供者:renee
  1. Rapid_Prototyping_of_Digital_Systems__SOPC.tar

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  2. Rapid prototyping of Digital system and SOPC VHDL Altera DE2 board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:16.07mb
    • 提供者:djauregu
  1. fir_filter

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  2. 一种fir滤波器的verilog程序,非常实用-fir filter very good write by verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.14kb
    • 提供者:ningbo
  1. shumadisplay

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  2. 一种用verilog写的数码显示程序,编译通过,可下载到fpga中-program of shumadisplay,write by verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:617byte
    • 提供者:ningbo
  1. sync_fifo

    0下载:
  2. 一种同步的先入先出verilog程序,可正确地通过编译-a programe of fifo wrote by verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:4.36kb
    • 提供者:ningbo
  1. dianziqing

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  2. 利用Verilog语言设计一个简易电子琴-Verilog design a simple keyboard
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.13mb
    • 提供者:王阳
  1. lift_control

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  2. 利用Verilog设计的电梯控制器代码,通过QUARTUS进行仿真-Elevator controller design using Verilog, simulation by QUARTUS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:477kb
    • 提供者:王阳
  1. Control

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  2. 维特比译码器控制器部分Verilog代码-The controller part of the Viterbi decoder in Verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:604byte
    • 提供者:王阳
  1. modelsim-ALTERA-manual

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  2. 经常的modelsim使用手册,和Altera公司的FPGA软件配套使用-Regular modelsim manual, and Altera' s FPGA software supporting the use of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.91mb
    • 提供者:hemy
  1. DAC0832_control

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  2. 用verilog HDL编程实现的基于DAC0832的三角波信号,可借鉴编程实现DAC0832芯片控制-Programming with verilog HDL DAC0832-based triangular wave signal, we may learn programming DAC0832 chip control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:637byte
    • 提供者:hemy
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