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  1. lcd1602_drive

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  2. 简介 程序是用quartus.exe 开发的verilog 源程序 实现了lcd1602的驱动-About quartus.exe development program is implemented lcd1602 verilog source driver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1.73kb
    • 提供者:
  1. uart_rx

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  2. quartus.exe 环境下经过编辑和仿真之后,作为FPGA器件的实验用串口接收数据驱动。 -quartus.exe edited and policy environment after the experiment as the FPGA device to receive data-driven serial port.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1.49kb
    • 提供者:
  1. eeprom_wr

    0下载:
  2. 本程序是quartus.exe 环境下经过编辑和仿真之后的eeprom中的i2C 通讯协议的驱动程序-This program is quartus.exe edited and simulation environment after the eeprom in the protocol driver i2C
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.66kb
    • 提供者:
  1. Xming

    0下载:
  2. Xming X Server 配置和使用,已测试!好用-Xming X Server to configure and use, have been tested! Easy to use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:132kb
    • 提供者:wangnan
  1. Piano

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  2. Simple Piano generator - different frequencyis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.58kb
    • 提供者:yo Man
  1. projektimikroprocesori

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  2. microprocessor in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:141.14kb
    • 提供者:ina
  1. CONTROL_DAC

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  2. Seno Generator, for Altera DE2-70 This is a generator of seno signal and the output will be displayed in the VGA DAC of the board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:2.93kb
    • 提供者:Felix
  1. Promediador

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  2. This a Promediator for the Altera DE2-2 it use a looktable for obtein the data and then promediates the current sample with 3 past samples.-This is a Promediator for the Altera DE2-2 it use a looktable for obtein the data and then promediates the cur
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:8.08kb
    • 提供者:Felix
  1. Multiplicador

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  2. This a Generic multiplicator.-This is a Generic multiplicator.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:4.76kb
    • 提供者:Felix
  1. INC_DEC_GEN

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  2. This an Generic Incrementer - Decrementer made wid flip-flops in VHDL-This is an Generic Incrementer - Decrementer made wid flip-flops in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:6.52kb
    • 提供者:Felix
  1. CORR_REG

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  2. This an Generic Shift Register made in vhdl-This is an Generic Shift Register made in vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.85kb
    • 提供者:Felix
  1. cordic

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  2. FPGA中数字信号发生器NCO用CORDIC实现产生正弦余弦-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1.76kb
    • 提供者:lilun
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