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  1. yuandaima

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  2. FPGA多功能数字钟,描述语言VHDL,软件环境QuartusⅡ-FPGA multi-function digital clock, descr iption language VHDL, Quartus Ⅱ software environment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:2.32kb
    • 提供者:李敬超
  1. usb

    0下载:
  2. USB完整代码 包括vhdl和verilog两种-usb ip core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:253.54kb
    • 提供者:王强
  1. Desktop

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  2. crc校验码verilog代码,24bits,按原理写的代码-cyclic redundancy check 24 bits verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:692byte
    • 提供者:陈阳
  1. Desktop

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  2. 用verilog HDL编写的多路选择器的代码,包括一部分延迟-Prepared using verilog HDL code MUX, including part of the delay
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:16.41kb
    • 提供者:陈阳
  1. Modelsim

    0下载:
  2. 这是一个modelsim的中文使用教程,主要讲述的是写代码前的操作-This is the Chinese use a modelsim tutorial is mainly about the operation before writing code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:379.36kb
    • 提供者:陈阳
  1. my_nand

    0下载:
  2. 与非门,Verilog实现,带实验说明文档。-NAND gate, Verilog implementation, with test documentation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:876.9kb
    • 提供者:
  1. ceshi904

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  2. 这是ad904的测试程序,用vhdl语言编写的。看它转换是否正常-This is the ad904 testing procedures, using vhdl language. Whether it is normal to see it change
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-15
    • 文件大小:23.18mb
    • 提供者:朱西
  1. experienceoffpga

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  2. 主要谈谈FPGA设计时的注意事项和一些基本概念。这些都是一位有着多年FPGA设计经验的肺腑之言。-FPGA design of the main talk and notice some basic concepts. These are the years of FPGA design experience with a heartfelt words.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:944.37kb
    • 提供者:张桂榕
  1. lcd

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  2. FPGA嵌入式开发中的NIOSii的LCD1602控制程序。-FPGA NIOSii LCD1602
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:571byte
    • 提供者:
  1. AD_TLC5510

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  2. 用TLC5510实现高速A/D采样。用状态机的方法实现,在状态st0,给A/D一个采样时钟adck的上升沿,同时锁存A/D的输出-Using TLC5510 high-speed A/D sampling. The method used to achieve a state machine, in the state st0, to A/D sampling clock adck a rising edge of, and latched A/D output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:172.41kb
    • 提供者:哈哈
  1. mc8051

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  2. 用VHDL在FPGA上实现8051内核,代码简单,易懂-Implemented on FPGA using VHDL in the 8051 core, the code is simple, easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:385.09kb
    • 提供者:yang fa sheng
  1. SHIFTER

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  2. SHIFTER描述移位寄存器的功能以及VHDL硬件语言的实现-SHIFTER describe the functions of the shift register and the realization of VHDL hardware language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:2.94kb
    • 提供者:SHEIN
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