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  1. ccvfk

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  2. Modulated signals to calculate its density Pu-related, matlab prepared cellular automata, Combination formula DSmT evidence reasoning calculation function.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:4kb
    • 提供者:fuifaojangyiu
  1. 2672

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  2. Genetic algorithm based reactive power optimization, ML estimation method can be a good signal to noise ratio, Calculation of the Euclidean distance between the two matrices.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-27
    • 文件大小:4kb
    • 提供者:yeikingnan
  1. piu_wb65

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  2. The entire training process BP neural network, Car class-based truck driver trying to Matlab program, ofdm system simulation including 16qam modulation fft windowing modules plus cp.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-16
    • 文件大小:4kb
    • 提供者:guimuikaojing
  1. vsmkq

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  2. Particle image segmentation and matching subroutines themselves are prepared, Is the topic of the elementary school stage curriculum design, High-resolution array signal processing estimates.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:4kb
    • 提供者:gieewhbn
  1. UART-master

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  2. FPGA Based UART in Verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:4kb
    • 提供者:lsyy
  1. led流水灯

    0下载:
  2. 在vivado做的led流水灯,包括分频(Done in vivado LED water lamp, including frequency division)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-23
    • 文件大小:4kb
    • 提供者:ge_gege
  1. SD_audio

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  2. 编写verilog 程序 利用fpga 读取sd卡音频播放(Use FPGA to read SD card audio playback)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:4kb
    • 提供者:just to do
  1. xuartps_intr_example

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  2. microblaze uart vivado(vivado microblaze interrupt)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:4kb
    • 提供者:xilinxer
  1. ahb_master

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  2. AHB总线接口描述,MASTER的接口描述,AMB总线协议(AHB bus interface descr iption, MASTER interface descr iption, AMB bus protocol)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:4kb
    • 提供者:小萌子
  1. W5300_IF

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  2. 实现FPGA与W5300 芯片的百兆以太网通信 ,实际项目中应用很多(Fast Ethernet communication between FPGA and W5300 chip, the actual project in many applications)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:4kb
    • 提供者:bug赵
  1. MAKEAMIF

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  2. 用于生成xilinx开发环境中存储器ip core的mif数据文件的程序代码。(this program is used to generate mif file used by xilinx memory ip core.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:4kb
    • 提供者:asmreg
  1. MAKEXCOE

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  2. 用于生成xilinx开发环境中存储器ip core的coe数据文件的程序代码。(this program is used to generate coe file used by xilinx memory ip core.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:4kb
    • 提供者:asmreg
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