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  1. Lab5a.rar

    0下载:
  2. A C example to use DMA on Nios II platform,A C example to use DMA on Nios II platform
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.83kb
    • 提供者:gios78
  1. I2C_to_GPIO

    0下载:
  2. I2C总线到GPIO通用串口的硬件语言程序-I2C bus to the the GPIO universal serial port hardware language program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:1.83kb
    • 提供者:zhangwei
  1. minus

    0下载:
  2. 无符号数减法,结果在按下输出键后输出,有清零功能-minus no signal can be clear
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:1.83kb
    • 提供者:周晓辰
  1. spi

    0下载:
  2. SPI接口函数,实现双向通讯,速度12Mbps-SPI interface functions, two-way communication, speed of 12Mbps
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.83kb
    • 提供者:shixu
  1. liushuideng

    0下载:
  2. 流水灯,控制方向,对系统时钟进行分频,奇偶数闪亮-Water lights, control direction, the system clock frequency, odd even flashing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.83kb
    • 提供者:陈宇璐
  1. encoder

    0下载:
  2. the encoder are designed to two for switchcase and if else function in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.83kb
    • 提供者:prabakaran
  1. LinPF

    0下载:
  2. This a VHDL module that implements linear prediction filter based on NLMS (normalized least mean square). The module takes complex signal as input and output comlex signal (real and imaginary). Tap size is 4, bit precision is set to 12 bits.-This i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.83kb
    • 提供者:徐滨
  1. ahb2apb

    0下载:
  2. 为APB桥设计的一个版本,来源于miniarm中-this is a APBqiao
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-21
    • 文件大小:1.83kb
    • 提供者:葛瑞龙
  1. mianbandeng

    0下载:
  2. 面板灯控制器,带色温以及亮度调节,用2路PWM加1路模拟调光,亮度调光用PWM转换电路转成模拟量加模拟调光上。-Panel light control, and brightness adjustment with color temperature, plus 1 with 2-channel PWM analog dimming, brightness dimming by PWM conversion circuits convert analog analog dimming on th
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1.83kb
    • 提供者:kiuyzgt
  1. Verilog_devided

    0下载:
  2. Verilog HDL的分频器设计:二分频、三分频和奇分频 -Verilog HDL: the frequency is divided-by-2/3 or others
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.83kb
    • 提供者:李方
  1. costasc_verilog

    1下载:
  2. 实现costas环,用verilog语言实现,缺少乘法器,可以自己添加-Realization of Costas ring, with the Verilog language implementation, the lack of multiplier, you can add their own.
  3. 所属分类:VHDL编程

    • 发布日期:2014-03-16
    • 文件大小:1.83kb
    • 提供者:liuweiliang
  1. 32bit_adder

    0下载:
  2. 三十二位加法器设计,能实现求补、加减法运算并具有溢出标志-Thirty-two adder designed to complement, addition and subtraction operations and overflow flag
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:
    • 文件大小:1.83kb
    • 提供者:田小新
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