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  1. pcf8563

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  2. I2C总线接口实现,显示pcf8563实时数字时钟的秒,分,可设置报警功能-I2C bus interface implementation, display pcf8563 real-time digital clock, seconds, minutes, you can set the alarm function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.3kb
    • 提供者:凌应龙
  1. fft

    0下载:
  2. 用Verilog语言实现 fpga 上的 fft功能-The fft function to achieve fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:2.3kb
    • 提供者:linux
  1. fifo_srl_uni

    0下载:
  2. asynchronous fifo in vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.3kb
    • 提供者:spydeeps
  1. vhdl4

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  2. Various VHDL Programs developed in Modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:2.3kb
    • 提供者:Sivraj P
  1. shifter

    0下载:
  2. 四位移位寄存器的verilog代码,是我们老师编写的,非常专业,非常有参考价值-The verilog code of a 4-bit shifter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-21
    • 文件大小:2.3kb
    • 提供者:电先生
  1. 24750d1181204054-vga_text_1_1846

    0下载:
  2. full vga controller, for anybody, who learn verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.29kb
    • 提供者:lamvigian
  1. verilog乘法器设计

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  2. verilog乘法器设计
  3. 所属分类:VHDL编程

    • 发布日期:2011-07-21
    • 文件大小:2.29kb
    • 提供者:liang2088321
  1. LCD_SCREEN

    0下载:
  2. 利用了状态机的53种状态太分别描述LCD显示频的初始化、显示字符串“OK!”的时序图中的详细过程-Use of 53 states of state machine LCD display is too describe the frequency initialized, the string " OK!" The timing diagram of the detailed process
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:2.29kb
    • 提供者:wulei
  1. Video_mixer

    0下载:
  2. Video transient with support of Fade, Wipe, Cut and Fade to black.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.29kb
    • 提供者:ahmad
  1. hunliao

    0下载:
  2. 用vhdl编写的一个简单的混料程序,可以实现混料罐自动工作功能-Vhdl prepared with a simple mixing process, can achieve mixing function can work automatically
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.29kb
    • 提供者:zhijiyu
  1. sji

    0下载:
  2. 出租车记费器,能实现出租车的启动,暂停,记费和记时功能。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.29kb
    • 提供者:空军
  1. dds

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  2. 本设计使用8051单片机ip核,并用VHDL语言设计DDS的各功能模块,利用顶层设计的思想组合成DDS(直接数字频率综合)函数信号发生器,并与单片机ip核的I/O口相连。编译完下载到可编程逻辑器件中(FPGA),实现相应的功能。该设计中使用的是LCD2004液晶显示。-dds
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.29kb
    • 提供者:kelas
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