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  1. VHDL-Cookbook

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  2. core generator vhdl book
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-02
    • 文件大小:232.39kb
    • 提供者:joshua dorafshan
  1. FPGA

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  2. fpga design file ,introduce the fpga design and ski-fpga design file ,introduce the fpga design and skill
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:1.25mb
    • 提供者:刘鑫
  1. frequency-divider

    0下载:
  2. 基于Quartus2和Modlesim环境下编译顺利通过的分频器源程序代码-Source code compiled Quartus2, and Modlesim environment passed the divider
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:544byte
    • 提供者:曾红雨
  1. Verilog135example

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  2. Verilog的135个经典设计实例及代码-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:280.2kb
    • 提供者:LD
  1. FPGA-VGA

    0下载:
  2. 最全的FPGA-VGA方面的资料及源码,对于初学者来说非常有帮助 -failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-10
    • 文件大小:2.5mb
    • 提供者:LD
  1. FPGA-exmaple

    0下载:
  2. FPGA实例合集,包含步进电机定位控制系统VHDL程序与仿真,MASK调制VHDL程序及仿真-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-16
    • 文件大小:1.22mb
    • 提供者:LD
  1. ACCUM

    0下载:
  2. accumulator for direct digital synthesis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:1.06kb
    • 提供者:saleh m
  1. dt

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  2. 设计一个六层楼自动电梯控制器,电梯内有六个输入按钮响应用户的上下楼层请求,并有八段数码管显示电梯当前所在楼层位置;在每层电梯入口处设有请求按钮开关,指示用户的上或下的请求。由电机正反转控制电梯的上下运动,超载或关门中断由压力传感器传来信号给控制装置。-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-20
    • 文件大小:759.52kb
    • 提供者:grace
  1. VHDL_CAIDENG

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  2. 基于altera de2的流水灯循环程序,使用VHDL编写。-Based on a de2 Lantern cycle, use of VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:480.6kb
    • 提供者:钟小洲
  1. xiyijikongzhi

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  2. 基于altera DE2的洗衣机控制器设计。使用VHDL编写。-Based on the the Altera DE2 washing machine controller design. The use of VHDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:475.89kb
    • 提供者:钟小洲
  1. weideng

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  2. 基于altera DE2的汽车尾灯控制设计。使用VHDL编写。-Altera DE2-based the taillights control design. The use of VHDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:303.25kb
    • 提供者:钟小洲
  1. telphone

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  2. 基于altera de2的电话计费器设计,通过数码管显示时间和费用。vhdl编写-Meter design based on the altera de2 the phone, through the digital display time and costs. vhdl prepared
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-17
    • 文件大小:12.48kb
    • 提供者:钟小洲
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