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  1. FPGA

    0下载:
  2. fpga的相关例程,从爱问找到的,据说很实用-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:1.47mb
    • 提供者:
  1. a_vhd_16550_uart_latest.tar

    0下载:
  2. vhdl-fpga-c++-c-wireless networks-linux-verilog-cpld-arm-dsp
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:117.1kb
    • 提供者:Saeid Marandi
  1. ram_a

    0下载:
  2. EDA工具中内存单元模块的VHDL硬件描述语言设计-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-05
    • 文件大小:2.07kb
    • 提供者:kenny.iverson
  1. cpu

    0下载:
  2. EDA工具描述下的8位CPU硬件描述语言VHDL的设计-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-20
    • 文件大小:3.71mb
    • 提供者:kenny.iverson
  1. jisuan

    0下载:
  2. 通过查表,实现两个实数的加减乘除等算术运算,运算速度快-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:2.16mb
    • 提供者:kenny.iverson
  1. shift

    0下载:
  2. 此源代码的功能是对一个二进制数进行移位操作-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:1.13mb
    • 提供者:kenny.iverson
  1. ALU181

    0下载:
  2. 此源代码的功能是CPU中的运算单元的vhdl描述-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:947.3kb
    • 提供者:kenny.iverson
  1. 3freqcount

    0下载:
  2. 高速而有效的实现频率计数器的控制器部分,整个工程全部上传-Upload all of the high-speed and efficient implementation of the controller portion of the frequency counter, the whole project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:50.96kb
    • 提供者:kindheart
  1. LCD12864_verilog

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  2. fpga控制LCD屏幕全部用verilog设计可用,通过仿真测试-FPGA controls the LCD screen all the Verilog design are available through the simulation test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:17.79mb
    • 提供者:zengdeqian
  1. digital-clock-for-vhdl

    0下载:
  2. 6数码管显示时钟,带调时功能,能设置闹钟,闹钟响可人为停止,整点报时,带屏保,12和24小时制手动切换,可人为设置时间为倒计时-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-20
    • 文件大小:10.25kb
    • 提供者:廖宁
  1. key9

    0下载:
  2. 用FPGA实现的按键程序,9个按键显示数字0~8,已在quartus里面成功编译并用FPGA板验证过-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:756byte
    • 提供者:vera
  1. anjian

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  2. 属于verilog HDL程序,三个独立按键控制多位数码管显示三个不同的状态,已在FPGA板上验证过-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:485.8kb
    • 提供者:vera
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